アプリケーション・ノート (14)
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Understanding SYSCLK Jitter[AN4056]
デザイン・ファイル
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PowerQUICC® Processor with CPM (1 SCC, 1 SMC), 10/100 Ethernet
The MPC859DSL Integrated Communications Controller is a versatile one-chip integrated microprocessor and peripheral combination that can be used in a variety of controller applications. It particularly excels in CPE applications including DSL modems, IADs, and residential gateways. Like the MPC866, the MPC859DSL is a 0.18 micron version of the PowerQUICC® Family and can operate up to 66 MHz on the MPC8xx core. It has a 1.8 V core and a 3.3 V I/O operation.
The MPC859DSL is a Power Architecture-based derivative of NXP® Semiconductors' Quad Integrated Communications Controller (PowerQUICC). The embedded CPU on the MPC859DSL is the MPC8xx core, a 32-bit microprocessor built on Power Architecture technology, incorporating memory management units (MMUs) and instruction and data caches. The memory controller supports many memory types, including SDRAM. The CPM (Communications Processing Module) is optimized for CPE applications supporting simultaneous operation of Fast Ethernet (MII) and parallel ATM (UTOPIA), UTOPIA II Multi-PHY (up to 4 addresses), and many more features.
製品詳細
Features
- Single-issue, 32-bit version of the core (compatible with Power Architecture technology) with 32, 32-bit general-purpose registers (GPRs)
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The MPC859DSL provides enhanced ATM functionality over that of the
MPC860SAR.
The MPC859DSL adds major new features available in
"enhanced SAR" (ESAR)
mode, including the following:
- Multiple APC priority levels available to support a range of traffic pace requirements
- Port-to-port switching capability without the need for RAM-based microcode
- Simultaneous MII (100Base-T) and UTOPIA (half-duplex) capability
- Parameter RAM for both SPI and I²C can be relocated without RAM-based microcode
- Supports full-duplex UTOPIA leader (ATM side) operation using a "split" bus
- Up to 32-bit data bus (dynamic bus sizing for 8, 16, and 32 bits)
- UTOPIA port supports up to 4 PHY addresses
- Complete static design
- Memory controller (eight banks)
- General-purpose timers
- Fast Ethernet controller (FEC)
- System integration unit (SIU)
- Interrupts
- Communications processor module (CPM)
- Four baud rate generators
- One SCC (serial communication controller) for Ethernet (SCC1)
- One SMC (serial management channel) for UART (SMC1)
- One SPI (serial peripheral interface)
- One I²C (inter-integrated circuit) port
- Parallel interface port (PIP)
- One PCMCIA socket (Port B)
- Low power support
- Debug interface
- 1.8 V core, 3.3 V I/O
- 357-pin PBGA package
比較表
MPC866 Family Versions and Masks
| Qual | Process | Mask | IMMR [16:31] | |
|---|---|---|---|---|
| Rev 0.3 | MC | HiP6W | 3L90H | 0x0800 |
| Rev A.0 | MC | HiP6W | 0L96R | 0x0801 |
購入/パラメータ
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1-10 の 28 ドキュメント
コンパクトリスト
アプリケーション・ノート (14)
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Understanding SYSCLK Jitter[AN4056]
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MPC8xx Using BDM and JTAG[AN2387]
アプリケーション・ノート・ソフトウェア (3)
エラッタ (1)
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Device Errata for the MPC866 Family[MPC866CE]
データ・シート (1)
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MPC866/MPC859 Hardware Specifications[MPC866EC]
パッケージ情報 (1)
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PBGA Packaging Customer Tutorial[PBGAPRES]
ファクト・シート (2)
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USB-ML-PPCBDM Fact Sheet[USBMLPPCBDMFS]
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MPC866 PowerQUICC® Processor Fact Sheet[MPC866FACT]
リファレンス・マニュアル (3)
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MPC8xx Digital Signal Processing Addendum[MPC8XXRMAD]
製品変更のお知らせ (1)
製品概要 (2)
設計・リソース
ハードウェア
クイック・リファレンス
ボードタイプ.
1-5 の 6 ハードウェア提供
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エミュレータ、プローブ、プログラマPEmicro Cyclone FX programmer
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エミュレータ、プローブ、プログラマCodeWarrior® TAP
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エミュレータ、プローブ、プログラマUSB TAP for PowerQUICC® I
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追加ハードウェアを利用可能 パートナー・ソリューションの特集を表示.
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エミュレータ、プローブ、プログラマUniversal Multilink FX高速開発インターフェース
アクティブ -
エミュレータ、プローブ、プログラマPEmicro Cyclone programmer
アクティブ
エンジニアリング・サービス
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3 エンジニアリング・サービス
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インディペンデントデザインハウス (IDH)
ハードウェア/ソフトウェア・エンジニアリング・サービス
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インディペンデントデザインハウス (IDH)
トラステッド・アドバイザ・サービス
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インディペンデントデザインハウス (IDH)
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1 トレーニング
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